欢迎来到我们的双周报专栏。本次是香山双周报专栏的第 42 期，我们将通过这一专栏，定期介绍香山的开源进展，希望与大家共同学习，一起进步。欢迎大家通过公众号后台留言的方式与我们交流！
近期，昆明湖研发接近尾声，各组持续推进面积和时序的优化及验证文档，前端测试了理想 L1/L2 Cache 性能收益上限，后端实现多个性能优化，HybridUnit 合入新后端，访存继续推进向量扩展测试和预取优化，缓存继续推进多核测试和斜相联 LLC。本期还更新了昆明湖架构近期性能与物理布局。
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近期，昆明湖研发接近尾声，各组持续推进面积和时序的优化；前端开始着手验证文档，后端 Hybrid Unit 性能优化基本完成，访存实现向量 MMIO 访存，缓存持续推进四核修复和 CHI 测试。
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近期，昆明湖研发接近尾声，各组持续推进面积和时序的优化，后端实现更加激进的 load 推测快速唤醒，向量访存模块在 MinimalConfig 下完成初步功能验证，缓存中探索 L3 新替换算法，在硬件仿真加速器上实现了新的调试功能。本期还更新了昆明湖架构近期性能与物理布局。
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近期，昆明湖研发接近尾声，前端继续优化面积和时序，后端合并 HybridUnit 到新后端并通过 debug module 单核调试，访存 TLB 和 SMS 优化合入主线，向量访存有了阶段性成果，缓存上完成时序优化并跑通部分多核测试。此外，逐步开展了 FPGA 和硬件仿真加速器的联合调试。
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近期，昆明湖研发稳步推进，前端着手于面积优化，后端完成了部分模块的时序优化和模块迁移并推进了向量模块的开发，访存向量初版代码合入新后端，缓存调试了部分性能 bug。此次我们还新增了性能评估板块，用于记录近期趋于稳定的昆明湖性能。
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近期，昆明湖研发稳步推进，前端完成 FDIP 部分优化工作，后端继续推进向量功能单元，访存开始主要代码合并和时序优化等工作，缓存完成 Hint 优化和 CHI 相关的仿真测试；此外香山代码环境正式步入 chisel 6 时代，终于不用“编辑五分钟，编译一小时”了！
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近期，昆明湖研发稳步推进，前端修复部分 bug，后端目前着手于 BusyTable、快速反馈重定向、流水化 CVT 等优化点，访存稳步推进向量访存和预取相关优化，缓存已完成 CHI-TileLink 的顶层电路。
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近期，昆明湖研发稳步推进，前端稳步推进时序和性能的双向优化，后端实现了 CVT FP16 和部分 load 优化，访存 L1 预取工作合入主线并着手向量访存重写工作，缓存重构了 TileLink-CHI 转接口。
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近期，昆明湖研发稳步推进，前端修复部分时序问题，后端逐步推进向量浮点功能和 H 扩展工作，访存近期集中在通路优化、预取改进和部分向量代码合并等工作，缓存继续推进 CHI 和请求融合工作。
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近期，昆明湖研发稳步推进，前端修复部分时序问题，后端完成 IQ 重构代码并逐步推进向量浮点功能和 H 扩展工作，访存近期集中在通路优化、预取改进和部分向量代码合并等工作，缓存 refill 选择替换路工作合入主线。